數(shù)字電子技術仿真實驗教程

內(nèi)容概要

　　本書是配合高等學?！皵?shù)字電子技術”課程而編寫的一本教材。
　　《數(shù)字電子技術仿真實驗教程》中首先介紹了multisim
1：0的基本操作，然后介紹了各種數(shù)字邏輯電路的搭建和仿真過程。本書配有160多個仿真實驗電路，需要者可登錄清華大學出版社網(wǎng)站免費下載。
　　《數(shù)字電子技術仿真實驗教程》可作為高等院校電氣、電子、通信、計算機、自動化和機電等專業(yè)的教輔、實驗教材及參考書。

書籍目錄

第1章　multisim 10的基本操作
1．1multisim 10的用戶界面及設置
1．1．1multisim 10的啟動
1．1．2multisim 10基本界面簡介
1．1．3multisim 10基本界面的定制
1．2multisim 10元器件庫及其元器件
1．2．1multisim 10的元器件庫
1．2．2元器件的查找
1．2．3使用虛擬元器件
1．3mulitisim 10虛擬儀器的使用
1．3．1雙通道示波器
1．3．2四通道示波器
1．3．3字信號發(fā)生器
1．3．4邏輯分析儀
1．3．5邏輯轉(zhuǎn)換儀
1．3．6函數(shù)信號發(fā)生器
1．4建立仿真電路的基本操作
1．4．1創(chuàng)建電路圖文件
1．4．2放置元器件
1．4．3元器件布局
1．4．4元器件的連線
1．4．5圖紙文字編輯
1．4．6保存電路
第2章　邏輯代數(shù)
2．1邏輯函數(shù)的仿真實驗
2．1．1基本邏輯函數(shù)及運算
2．1．2幾種常見的邏輯運算的仿真
2．2邏輯代數(shù)基本定律的證明
2．2．1摩根定律的證明
2．2．2分配律的證明
2．2．3反演規(guī)律的證明
2．2．4代人規(guī)則
第3章　邏輯門電路
3．1分立元件門電路
3．1．1二極管門電路
3．1．2三極管的開關特性
3．1．3mos管開關特性
3．1．4分立元件門電路
3．2ttl集成邏輯門電路的仿真
3．2．1ttl非門的傳輸延遲時間
3．2．2集電極開路門(oc門)
3．2．3三態(tài)門(ts門)
3．2．4ttl電路的灌電流負載和拉電流負載
3．3cmos集成邏輯門電路的仿真
3．3．1cmos反相器
3．3．2其他類型cmos門電路
第4章　組合邏輯電路的仿真
4．1組合邏輯電路的分析與設計
4．1．1組合邏輯電路的分析仿真實驗
4．1．2組合邏輯電路的設計仿真
4．2編碼器的仿真實驗
4．2．13位二進制編碼器的仿真
4．3譯碼器的仿真實驗
4．3．1二進制譯碼器的仿真
4．3．2二—十進制譯碼器的仿真
4．3．3顯示譯碼器
4．4加法器和數(shù)值比較器的仿真
4．4．1一位加法器
4．4．2數(shù)值比較器
4．5數(shù)據(jù)選擇器和數(shù)據(jù)分配器的仿真
4．5．1數(shù)據(jù)選擇器的仿真
4．6．組合電路中的競爭冒險的仿真
4．6．1產(chǎn)生負尖峰脈沖冒險
4．6．2產(chǎn)生正尖峰的脈沖冒險
4．6．3競爭冒險現(xiàn)象的消除
第5章　集成觸發(fā)器的仿真實驗
5．1基本rs觸發(fā)器的仿真
5．1．1由與非門組成的rs觸發(fā)器
5．1．2由或非門刁組成的基本rs觸發(fā)器
5．2同步觸發(fā)器的仿真
5．2．1同步觸發(fā)器的空翻轉(zhuǎn)現(xiàn)象
5．3邊沿觸發(fā)器的仿真
5．3．1維持阻塞d觸發(fā)器
5．3．2邊沿jk觸發(fā)器
5．3．3主從jk觸發(fā)器
5．3．4t觸發(fā)器和t，觸發(fā)器
5．4觸發(fā)器之間的轉(zhuǎn)換仿真
5．4．1d觸發(fā)器轉(zhuǎn)換為t和t，觸發(fā)器
5．4．2jk觸發(fā)器和d觸發(fā)器之間互換
第6章　時序邏輯電路的仿真實驗
6．1異步計數(shù)器的仿真實驗
6．1．1異步二進制加法計數(shù)器
6．1．2異步二進制減法計數(shù)器
6．1．3異步十進制加法計數(shù)器的仿真
6．1．4集成二進制異步計數(shù)器仿真
6．2同步二進制計數(shù)器的仿真實驗
6．2．1同步二進制加法計數(shù)器的仿真
6．2．2同步二進制減法計數(shù)器的仿真
6．2．3集成同步二進制計數(shù)器74ls161和74ls163
6．3同步十進制計數(shù)器的仿真實驗
6．3．18421bcd碼同步十進制加法計數(shù)器
6．3．2集成同步十進制加法計數(shù)器74ls160和74ls162
6．3．3集成同步十進制加、減法計數(shù)器74ls190的仿真
6．4集成計數(shù)器容量擴展的仿真
6．4．1串行進位方式和并行進位方式
6．4．2整體置0方式和整體置數(shù)方式
6．5數(shù)碼寄存器的仿真實驗
6．5．14位數(shù)碼寄存器的仿真實驗
6．5．2移位寄存器的仿真實驗
6．5．3移位寄存器的應用仿真
第7章　脈沖信號的產(chǎn)生與整形的仿真實驗
7．1多諧振蕩器的仿真實驗
7．1．1由門電路構(gòu)成的多諧振蕩器
7．1．2石英晶體振蕩器的仿真
7．1．3555定時器構(gòu)成的多諧振蕩器
7．1．4555定時器的應用
7．2555定時器的仿真實驗
7．2．1555定時器邏輯功能的仿真測試
7．3施密特觸發(fā)器的仿真實驗
7．3．1用555定時器組成的施密特觸發(fā)器
7．3．2集成施密特觸發(fā)器
7．3．3施密特觸發(fā)器的應用
7．4單穩(wěn)態(tài)觸發(fā)器仿真實驗
7．4．1用555定時器組成的單穩(wěn)態(tài)觸發(fā)器
7．4．2集成單穩(wěn)態(tài)觸發(fā)器的仿真
7．4．3555定時器作單穩(wěn)態(tài)觸發(fā)器的應用
第8章　d／a轉(zhuǎn)換與a／d轉(zhuǎn)換的仿真實驗
8．1d／a轉(zhuǎn)換仿真實驗
8．1．1權(quán)電阻網(wǎng)絡d／a轉(zhuǎn)換器
8．1．2r-2r倒t形電阻網(wǎng)絡d／a轉(zhuǎn)換器
8．1．38位集成d／a轉(zhuǎn)換器仿真實驗
8．2a／d轉(zhuǎn)換仿真實驗
8．2．18位a／d轉(zhuǎn)換電路仿真
8．3綜合應用a／d和d／a轉(zhuǎn)換電路
第9章　綜合設計與仿真
9．1搶答器的仿真
9．1．14路搶答器
9．1．2數(shù)顯八路搶答器
9．2計數(shù)及顯示電路
9．2．1一位數(shù)的計數(shù)電路
9．2．2兩位數(shù)的計數(shù)電路
9．2．3三位數(shù)的計數(shù)電路
9．3彩燈循環(huán)控制器
9．3．1十盞燈循環(huán)點亮
9．3．216盞燈循環(huán)點亮
9．4數(shù)字電子鐘
9．4．1數(shù)字電子鐘
附錄a常用數(shù)字集成電路索引
附錄bmultisim 10元器件菜單欄及元器件庫元器件速查
參考文獻

章節(jié)摘錄

版權(quán)頁：   插圖：   同步D觸發(fā)器雖然解決了同步RS觸發(fā)器輸入端存在的約束問題，但缺點是存在著空翻現(xiàn)象。所以，它只能用于數(shù)據(jù)鎖存，不能用作計數(shù)器、移位寄存器和存儲器。 案例5—3：D鎖存器。 鎖存器是能夠存儲二進制數(shù)0和1的邏輯電路。D鎖存器與D觸發(fā)器的特性不同：D觸發(fā)器輸出端的狀態(tài)變化，是在CP脈沖上升沿時刻被觸發(fā)而變化（見后面的邊沿D觸發(fā)器），其余時間保持不變。D鎖存器則是在CP有效期間，輸出端Q狀態(tài)跟隨輸入信號D變化而變化，可多次變化，即存在“空翻”現(xiàn)象。鎖存器是電平控制的，而D觸發(fā)器是邊沿控制的。 一位D觸發(fā)器只能傳送或存儲一位數(shù)據(jù)，而在實際中往往希望一次傳送或存儲多位數(shù)據(jù)。為此，可把多個D觸發(fā)器的時鐘輸入端口CP并聯(lián)起來，用一個公共的控制信號來控制，而各個數(shù)據(jù)端口仍然是各自獨立地接收數(shù)據(jù)。鎖存器也稱為透明鎖存器，當它的鎖存信號不起作用時，輸出信號隨輸入信號變化，就像信號通過一個緩沖器一樣，一旦鎖存信號起作用，則數(shù)據(jù)被鎖住，輸入信號不再起作用。 圖5—11為4D鎖存器74LS75組成的數(shù)據(jù)鎖存器電路，它有4個數(shù)據(jù)輸入端和4個數(shù)據(jù)輸出端，1LE和2LE并聯(lián)起來作為鎖存選通信號，可以并行存取四位二進制數(shù)據(jù)，輸入數(shù)據(jù)信號由字信號發(fā)生器產(chǎn)生并輸出：0000，0001，…，1111。當鎖存選通端為“1”時，鎖存器的輸出端跟隨輸入信號的變化而變化，一旦鎖存選通信號為0，鎖存器立即關閉，并鎖存關閉之前一時刻輸入的數(shù)據(jù)。同樣，集成電路74LS373是8D鎖存器（三態(tài)），可并行存取8位二進制數(shù)。

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